gelöst Lange Simulationszeiten bei Worst-Case-Analyse

kroko

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Hallo, miteinander

Ich habe eine Worst-Case-Analyse mit OpAmps, wo ich die Offset-Spannung mit +/-5mV variieren möchte.
Die Simulationszeit geht ewig (nach 30min sind 14% simuliert), während die Schaltung sonst in Bruchteilen einer Sekunde berechnet wird.

Die OpAmps haben als Versorgungsspannung nur V-=0V & V+=+15V

Im anhängenden Screenshot ist nur die "nominale" Schaltung mit VOS2=(-) 5mV gezeigt.

Liegt das an der negativen Offset-Spannung, die unter V- liegt?
Was ist die Ursache dafür?

Danke und Gruss
 

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  • LTSpice_Schaltung.png
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  • LTSpice_Simulationszeit.png
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Hi @kroko und willkommen

Man könnte Dir besser helfen, wenn Du den betreffenden Schaltplan (asc) inkl. allfälliger zusätzlichen Libraries anhängen würdest.
Auf den ersten Blick fällt mir auf, dass die OPAs, NPN und PNP Transistoren nicht definiert sind.
 
Zuletzt bearbeitet:
Hoi, @spicer

Stimmt... Im Anhang mein Schaltplan.

Wenn man weitere Bauteilwerte zur WC-Analyse dazufügt, dauert die Simulation Tage...

Danke und Gruss,
@kroko
 

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  • CAS_SSC_Analog_Output_Darlington_-_FuncAna_-_Voltage_Mode_-_WC_RES_OS.asc
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Hier mal Dein Schaltplan mit integrierter BAS316 und im 6ms Bereich ;)
 

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  • CAS_SSC_Analog_Output_Darlington_-_FuncAna_-_Voltage_Mode_-_WC_RES_OS.asc
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Zuletzt bearbeitet:
Hoi
Danke für das File. Aber irgendwie kann ich das File nicht runterladen.
Bei meinem File im Chat kommt sofort ein Pop-up mit "Download" - bei dem neuen leider nicht
 
Hoi

Danke für das Einfügen der lokalen BAS316 Direktive (die hatte ich auch ergänzt, war aber noch nicht abgespeichert).
Das Problem mit der Dauer ist leider immer noch da.

Danke und Gruss
 
:)
Diese Funktionen machen "Worst Case Analysen". Das klappt auch gut. Nur beim OpAmp mit VOS unterhalb von V- hakt es bzw. dauert es lange...

Auf Youtube gibt es eine gute Erklärung und auch ein Paper von Analog-Devices:

  • Während die Funktion wc eine relative Abweichung vom Nominalwert variiert, macht die Funktion wc_abs eine absolute Abweichung (0V +/- 5% wäre ja sonst immer noch 0V).
  • Beide Funktionen wc und wc_abs haben als 3. Parameter "index". Zunächst nummeriert der Parameter "index" die WC-Parameter von 0 bis n durch, Parameter "index" wird von der Funktion binary genutzt, um eine Tabelle mit Nullen und Einsen zu machen (siehe AD-Paper).
 
Ich habe mal standard Transistoren eingesetzt.
opo1 geht da in den kV Bereich...

Auswahl_009.png
 

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  • CAS_SSC_Analog_Output_Darlington_-_FuncAna_-_Voltage_Mode_-_WC_RES_OS.asc
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Vorschlag zur "langen Simulationszeit": Hinter .tran 6m uic einfügen, ergibt bei mir "total elapsed time" ca. 549sec (etwa 9 Minuten). Die Simulation startet damit sofort nach dem RUN-command.
Zwischen opo2 und Basis von Q3 empfiehlt sich ein Begrenzungswiderstand, da Q3 und Q1 relativ niederohmig sind und R1 nur 96,3 Ohm hat. (Imax von opo2 ? ).
 
Hoi

Ich habe jetzt die Worst-Case-Analyse-Elemente entfernt. Für den negativen OpAmp-Offset -0.5mV sehe ich den gleichen Effekt. Mit VOS2=0.5V läuft es in 1 Sekunde durch (siehe Anhänge).

Danke und Gruss
 

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  • LTSpice_Schaltung_-_No_WC_VOS2_5mV.png
    LTSpice_Schaltung_-_No_WC_VOS2_5mV.png
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  • CAS_SSC_Analog_Output_Darlington_-_FuncAna_-_Voltage_Mode_-_Nom.asc
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Vorschlag zur "langen Simulationszeit": Hinter .tran 6m uic einfügen, ergibt bei mir "total elapsed time" ca. 549sec (etwa 9 Minuten). Die Simulation startet damit sofort nach dem RUN-command.
Zwischen opo2 und Basis von Q3 empfiehlt sich ein Begrenzungswiderstand, da Q3 und Q1 relativ niederohmig sind und R1 nur 96,3 Ohm hat. (Imax von opo2 ? ).
Danke für den Tip. Probiere ich mit und ohne WC (worst case) aus.
 
Hi kroko,

hast Du für die Transistoren PNP keine realen Bauteile, z.B. aus der Lib, eingesetzt? Es ist immer ratsam, dies zu tun. R9 einzubauen war gut, wegen des Ableistromes (Abbau von Restströmen)
 

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